LSIのレイアウト設計

サイト 図研テック株式会社

半導体メモリやＣＭＯＳセンサ等高速インターフェースのレイアウト設計、特性検証、信頼性検証、物理検証、評価フィードバック等

  • 職　種
    LSIのレイアウト設計
  • 仕事内容

    半導体メモリやＣＭＯＳセンサ等高速インターフェースのレイアウト設計、特性検証、信頼性検証、物理検証、評価フィードバック等を担当して頂きます。

  • 求める人材

    アナログレイアウト設計のご経験がある方

  • 歓迎するスキル・志向

    アナログレイアウト設計のご経験に加えて、設計・検証ツールの環境構築、作成、管理に携わったご経験のある方

  • 給　与
    当社規定による
  • 諸手当
    時間外手当全額支給、通勤交通費支給
  • 昇　給
    年1回（4月）
  • 賞　与
    年2回（6月、12月）
  • 勤務地

    本社、大宮オフィス、名古屋オフィス、大阪オフィス
    ※図研ユーザーを含むモノづくりメーカの支援のために、首都圏・東海エリア・関西エリアを中心にオンサイト勤務の可能性があります

  • 勤務時間
    9:00～17:45 　標準労働時間 7時間45分
  • 休日休暇
    完全週休2日制、祝日、年次有給休暇、慶弔休暇、特別休暇、年間休日128日（2022年度）
  • 保　険
    健康保険、厚生年金保険、雇用保険、労災保険
  • 福利厚生

    財形貯蓄制度、退職金制度、確定拠出年金制度、体育奨励施設・健康保険組合契約保養所宿泊費補助、リゾートトラストが運営する会員制リゾートホテル・ゴルフ場・スパリゾート施設の利用、会員制優待プログラム［ベネフィット・ステーション］、神奈川県情報サービス産業健康保険組合直営及び借上げ施設、資格取得奨励金、住宅支度金制度（遠隔地採用時）　他

  • その他

    ノー残業デー（水・金）

  • 連絡先

    〒222-8505　横浜市港北区新横浜3-1-1　図研新横浜ビル
    TEL：045-470-9933 （採用グループ直通）
    FAX：045-471-2442
    Mail：ztec.sai@zukentec.com（採用グループ 専用アドレス）

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